Le blog de Philippe Quemerais

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jeudi 18 août 2011

Use of CAD tools at the ENSSAT : licensing modification

Since the 7th july 2011, to use the Cadence software at the ENSSAT, you will have to configure the licensing system with one more port value : 30000@hurin.cnfm.fr

To summarize, if you want to feel easy with the use of every CAD tools (Synopsys, Mentor Graphics, Xilinx, Cadence, ...), let set the LM_LICENSE_FILE variable like described below.

For linux csh or tcsh : setenv LM_LICENSE_FILE 1717@loth2:1717@loth3:1717@loth4:27000@hurin.cnfm.fr:30000@hurin.cnfm.fr

For linux sh or bash: LM_LICENSE_FILE=1717@loth2:1717@loth3:1717@loth4:27000@hurin.cnfm.fr:30000@hurin.cnfm.fr export LM_LICENSE_FILE

For windows : LM_LICENSE_FILE=1717@loth2;1717@loth3;1717@loth4;27000@hurin.cnfm.fr;30000@hurin.cnfm.fr and for matlab, MLM_LICENSE_FILE=1717@loth2,1717@loth3,1717@loth4

vendredi 13 mai 2011

ExpressChip circuits just arrived !

ExpressChip circuit arrived !

Technology 65nm bulk cmos, cmos065 STMicroelctonics.

The die is 1000µmX1000µm large.

ExpressChip die bounded

ExpressChip die

The package is a QFN52 (8mmX8mm).

ExpressChip package (top)

ExpressChip package (bottom)

mardi 7 décembre 2010

ExpressChip : cmos 65nm, 1000µ X 1000µ

Ochre_V2 just arrived and we are already sending our new chip : ExpressChip. The design is ready for fabrication and will be soon sended by CMP to STMicroelectronics.

ExpressChip is a digital circuit made up of a microcontroleur core (OpenMSP) and of the digital part of a radio transceiver

Low power design technics (power gating, multi Vt, ...) are used.

Why "ExpressChip" : this chip was designed (front and back end) in only 6 weeks !

Two goals : test of OpenMSP design and get experience with the ST 65nm bulk cmos technology design flow and its low power design facilities.

Technology : 65nm bulk cmos, cmos065 STMicroelctonics

Run : 29th november 2010

Expected delivery : 1st march 2011

ExpressChip : 1000µX1000µ, cmos 65nm, STMicroelectronics

mardi 30 novembre 2010

Ochre_V2 : to be tested

We just received our circuits Ochre_V2. Technology ST Microelectronics 130nm cmos hcmos9gp Surface : 2100 µ X 2100 µ

Ochre_V2 : die picture Ochre V2 bounding 1 Ochre_V2 : CQFP64

vendredi 1 octobre 2010

Ochre V2 : le prochain ASIC de l'équipe IRISA-CAIRN

Le prochain circuit ASIC de l’équipe CAIRN est en cours de fabrication. (Technologie CMOS 130 nm, STMicroelectronics HCMOS9GP, 4 mm²)

Les puces sont attendues pour le 15 novembre 2010.

Il s’agit d’un générateur de nombres aléatoires avec une analyse en ligne de la qualité des nombres générés.

En attendant la photo de la puce :

Dernier circuit réalisé

mardi 24 août 2010

Plateforme d'étude des radiocommunications sans fil


Ochre V1


http://www.irisa.fr/cairn/hardware/ochre-v1

lundi 23 août 2010

Aux utilisateurs des outils de CAO de circuits intégrés de l'ENSSAT

Pour utiliser les outils de CAO de l’ENSSAT, vous devez avoir créé la variable d’environnement LM_LICENSE_FILE et l’avoir initialisée comme ci-dessous :

linux (csh) : setenv LM_LICENSE_FILE 1717@loth2:1717@loth3:1717@loth4:27000@hurin.cnfm.fr

Windows : Propriétés système, onglet Avancé, Variable d’environnement; LM_LICENSE_FILE 1717@loth2;1717@loth3;1717@loth4;27000@hurin.cnfm.fr